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ENE架构的问题

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发表于 2009-8-18 10:37:16 | 显示全部楼层 |阅读模式
SPI flash rom挂在EC下面。
; ]% c% a- o  V+ ?7 l8 J3 ?/ i6 C& l5 X7 @7 F; J
1. 请问EC里的8051在fetch在SPI flash ROM code时,这时host通过LPC也要读或写SPI flash ROM,+ H- Q( ^6 B  W2 K" s: x
    要让8051进入IDLE mode?这时是不是就是PETER大侠说的更新NVROM?
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" ~9 Y: e) _9 ?9 {2. 通过SPI fetch flash rom code,若8051 run 22MHz,SPI interface run 33MHz,来得及让8051每
* P/ ]. ~( ^  x( o    条指令fetch一次吗?小弟算好像来不及,莫非与晶片内部的2k-XROM有关?
, V/ i3 L3 s8 c9 U; h/ L3 T( C2 u1 C/ m' I( o7 `1 @  u8 S3 J# y
3. 8051 fetch SPI ROM 时,是用那条指令?参考peter大侠文章说的W25X80那颗,开机时,第一条指令要怎么读?
; k& O! m) S5 y- q' M8 H" j8 k! E3 Y$ ?1 ^& ?7 o, o
小弟是新手,没做过,各位大哥赐教。$ q+ j- q3 r. J( H( ?+ `: ^2 |' ~" c

0 q6 M7 T9 D/ g% ][ 本帖最后由 volpone 于 2009-8-18 10:38 编辑 ]
发表于 2009-12-10 22:15:00 | 显示全部楼层
好问题,虽然在做ENE的EC,但是回答不来,顶一下吧,这里最近好冷清了。
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发表于 2009-12-12 15:05:53 | 显示全部楼层
1. 请问EC里的8051在fetch在SPI flash ROM code时,这时host通过LPC也要读或写SPI flash ROM
8 ^% q. P9 ?8 q/ q% o    要让8051进入IDLE mode?这时是不是就是PETER大侠说的更新NVROM?
8 g( E/ q3 R% P' m=====================================================================
3 t0 r+ i  X' x+ `1 v, H读取由LPC to SPI桥控制,不需要你控制。写入需要让8051停止取指令% W. ~$ r) i  U* X* V
=====================================================================2 N  h9 ]: i+ I6 u/ r
2. 通过SPI fetch flash rom code,若8051 run 22MHz,SPI interface run 33MHz,来得及让8051每: g# B; }( L  C8 `) N/ g
    条指令fetch一次吗?小弟算好像来不及,莫非与晶片内部的2k-XROM有关?
$ W: ^0 y  `& Y3 t================================================================
7 B* @# f4 m# r, P) t, UENE的EC是3 cpu cycles per instructtion cycles,而大部分指令又需要2个或者更多 instruction cycles,9 g* C) ]) |: r0 K0 J
因此,MIPS为3.7M,再加上有指令缓存,应该是来得及的$ N+ G: |; R. _. F! ~0 w2 @
================================================================
. ^8 _* z4 F& W3. 8051 fetch SPI ROM 时,是用那条指令?参考peter大侠文章说的W25X80那颗,开机时,第一条指令要怎么读?
0 L% }  Y; {, z) @0 C小弟是新手,没做过,各位大哥赐教- |9 h" n. J  g: V
================================================================) U+ Z6 m- E& g* \  `0 `0 v* U
没有指令。8051已经为你做好了这些9 t- n& z1 V% H- |# a7 j
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发表于 2009-12-14 11:11:20 | 显示全部楼层
8051内部电路是不是有code buffer?
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