ENE架构的问题

volpone

SPI flash rom挂在EC下面。
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1. 请问EC里的8051在fetch在SPI flash ROM code时，这时host通过LPC也要读或写SPI flash ROM，
    要让8051进入IDLE mode？这时是不是就是PETER大侠说的更新NVROM？

* f; K5 b: p: ~' S, m% p& @% ]2. 通过SPI fetch flash rom code，若8051 run 22MHz，SPI interface run 33MHz，来得及让8051每
# Q5 R# b% Q  V( s    条指令fetch一次吗？小弟算好像来不及，莫非与晶片内部的2k-XROM有关？
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4 S2 S" X: c; T0 e! ^1 K3. 8051 fetch SPI ROM 时，是用那条指令？参考peter大侠文章说的W25X80那颗，开机时，第一条指令要怎么读？
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  T. J. C1 K7 S: U4 v! x: h小弟是新手，没做过，各位大哥赐教。

[ 本帖最后由 volpone 于 2009-8-18 10:38 编辑 ]

jacksonwxm

好问题，虽然在做ENE的EC，但是回答不来，顶一下吧，这里最近好冷清了。

qdk0901

1. 请问EC里的8051在fetch在SPI flash ROM code时，这时host通过LPC也要读或写SPI flash ROM
3 ?6 g$ X4 `2 W4 F    要让8051进入IDLE mode？这时是不是就是PETER大侠说的更新NVROM？
  D9 |1 u! j* m) y' B) F=====================================================================
- n. e7 ?5 _: F" t+ r4 ^! i读取由LPC to SPI桥控制，不需要你控制。写入需要让8051停止取指令
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6 ?7 ^* z. F! F" F2. 通过SPI fetch flash rom code，若8051 run 22MHz，SPI interface run 33MHz，来得及让8051每
    条指令fetch一次吗？小弟算好像来不及，莫非与晶片内部的2k-XROM有关？
: b% }% x+ H: j- m/ m/ Z================================================================
- z- d) k! g1 I6 c& m/ W0 N8 [ENE的EC是3 cpu cycles per instructtion cycles,而大部分指令又需要2个或者更多 instruction cycles，
因此，MIPS为3.7M，再加上有指令缓存，应该是来得及的
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3. 8051 fetch SPI ROM 时，是用那条指令？参考peter大侠文章说的W25X80那颗，开机时，第一条指令要怎么读？
小弟是新手，没做过，各位大哥赐教
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没有指令。8051已经为你做好了这些
5 r, G% D" n! M7 b: Z8 n================================================================

chichitete

8051内部电路是不是有code buffer?