[转载]我所知道的BIOS -Jumpless 4

sdwenyliu

上一篇所提到的是:BIOS entry point. 它是第一個被 CPU 所抓取並執行指令之處.每家BIOS都有其相應的 file,要牢記.
( S8 S! y% j2 w( y% U
在本文中,要提及: Jumpless ! 在此要先說明Jumpless的意義.它代表:"用 s/w方式來 config clockgen generator,使之產生正確的 頻率s 來供應系統運作". 重要性在於:假如某個 frequency錯了,則將導致 system abnormal or malfunction...

有哪些 frequencies由 clockgen 提供?
  j/ l0 ~; P7 j+ T6 y- CPU clock (在此指的是 : host clock, Ex. FSB800 CPU 需被 supply 200MHz clock)
: t. ^% n! G$ L' z% ^- DRAM clock( depends on chipset design; Ex. DDR 533要被 supply 266MHz clock)
更正 : DRAM clock現在都是由NB產生 . 外部的最多是 buffer而已. 並非 clock generator. 原因是為了保持較良好的 host clock & DRAM clock的同步.
* N6 {. ^4 w6 N
3 M, ^2 o8 E5 Q1 E+ r補充:我舉的例子是以前的chipset design. 現在我做過的 chipset 其 DRAM clock的確由北橋來推. 北橋中有一會 register定義: CPU-DRAM ratio.
Ex. CPU clock = 100MHz. Ratio = 3:5,則可得 DRAM clock = 166MHz
0 O1 G* @2 |7 c, k' q3 a; \4 n
- AGP clock: 標準 is 66.6MHz (= 1/2 PCI clock)
- PCI clock: 33.3MHz
1 v# i% |8 V% E( ?2 v/ Y1 H- SATA clock: 100MHz(see SATA spec,似乎還要更精確...)
- Link clock: 即假如NB/SB中間有 link,亦由clockgen提供
- USB 1.1 clock: 12MHz
+ A- ^1 C- y! C3 j更正: USB 的 clock 是 48MHz
6 Y! Q0 g- K3 Y# Q! C0 J補充:我們 chipset的 design是: 由 clockgen提供 12MHz clock(或由 external crystal提供),被 PLL吃進去後,會產生 48MHz給 USB 1.1(你說的應該是這部分). 至於 USB 2.0,則是 supplied other freuencies !

* Z/ q- e- |$ E- SIO clock...etc
8 b+ F8 g* s& h, u2 Q
  Q: q% p# z9 Y3 |) u2 f; HClock Generator的架構
8 |0 ]- K8 H& I" N! j; _' B% i=> ClockGen基本組成為 PLL(Phase Looked Loop) + Div. PLL 的輸入為 14.318MHz, 利用 迴授方式產生出 frequency F;之後 經過 Div 除頻,便得到 desired frequency,見下列圖示:

+ t( a8 F+ i$ C. q14.318MHz -> PLL -> F -> Div -> f

( E7 \' Z& B/ Y/ ?6 B- REx. F = 400MHz, 為 PLL振出來的;若 Div = 4,則 f = 100MHz
9 `/ F7 J4 M% j5 L( y+ w
7 P6 P2 V) \( e; I' \, PClockGen的 spec中,會列出許多 registers,好比是 Function 的 "contact window",透過這些 registers可以設定此clockgen !

更正:其實PLL 不是單純一個的 div. 鎖相迴路的參數是兩的divider 組成 M(VCO divider)/N(REF divider)
補充:觀念上來說是 PLL所振出的頻率經 div後可得到 desired frequency. 但在 clockgen中:
3 W) {5 T& V, V- B) d1. 有 2 bytes(即所謂的M,N)來決定 VCO
( e9 R% C% Y, R, h2 D2. 有幾個 bits來決定 div;一些主要的 frequency都有相對應的div
! U9 ]8 d! W3 n. J$ Z) W9 Z1 Z3. VCO / div = frequency
- B/ a6 K4 q- Z* I: h
' r! O& X4 B! I+ m" aHow to access ClockGen
=>現今存取 clockgen的方式,都是透過 SMBUS來達成. SMBUS 有分 1.1 and 2.0,不過大同小異. SMBUS是 2-wire protocol;由 SMBUS master(即內建在南橋內部的 SMBUS controller )來下 command 給 SMBUS device(Ex. Clockgen);Command中常用的有 Block Read/Write & Byte Read/Write

4 @0 @! \6 |2 E8 J' g, X3 m) M7 D不同家 chipset 的 SMBUS controller implement方式不同,自然下command的方式亦不同;主要的步驟是:
- pre-init( clear status or ...)
- put slave address(要 access 的對象)
5 H% [4 L4 S! R5 t: e& U4 J- decide Read or Write
  J/ w3 m& l( Y* J2 f- put command(Protocol type, Ex. Block or Byte access)
2 h- w0 c: |7 p# }9 O- put offset(要存取 自 clockgen中的哪一個 Byte開始...)
  n- u% Z$ x9 a- H% n- put data if (Write device)
- k) ^& M: S3 D4 P8 F0 k0 H& n3 `. `- start transaction !!!
(... processing ...)
- get "Complete" status to check if transaction is done successfully
( A  A" V  `0 W7 T# Y& ?& P7 L" q(...wait for system reset...)
/ k2 ]4 V' T: C
$ @* @6 A' T& m. i* U$ _8 T& F9 N- c* M* 當 start transaction後, SMBUS controller便會將 programmer所 prepare的資訊將之轉成 SMBUS command打給 device;完成後應該在 controller端有 status register可以檢查,看看是否 transaction ok or failed,或是有其他 error conditions.

透過這樣的方法,programmer便可以 config clockgen使之產生正確的 frequencies.

[2 Programming ways for clockgen]
6 j& M" @; n; l) D$ b: T=> 現今的 ClockGen有提供兩種方式 for S/W config. 一為 table mode,一為linear mode. Table mode指的是: ClockGen spec 中會有一個 table,裡面說明: 要產生 ? frequency 要填 ? 值.因此,這種方式只需program 1 byte to Clockgen就行了. 若是 linear mode,則是坊間所說的無段變頻,即可以微調frequency. Ex. table mode只提供 100/133/166/200MHz,但 linear mode則可以提供類似 102.6/136.3/168.7..等的頻率. 此時,要program的 byte數就很多了.....除此之外, linear mode也可以config 所謂的 spread spectrum(%),板廠測EMI時會用到
2 `& d* T: F! Q+ |1 G! u& _
【Notes】
1. For NB platform power-on CPU frequency 由 2 pins來決定;DT platform會由 Jumper決定.不管如何,之後做Jumpless都可以 override掉原 clock settings

: @* U( G5 M$ Z6 Y- J3 v$ O更正: 不是只有NB如此.不管DT 或server. CPU FSB 也是 pin(由於FSB頻率比NB多.所以是 3 pins )來決定的.不是jumper. 即使要做超頻設計會對這三pin做手腳, 也不會使用jumper
8 }' Q% W$ [) h
' `! J1 A/ I8 `3 Y3 _" B! }) S
, c7 m; R$ F6 D! V0 r  l1 T2. 有些 clockgen所提供的 SS 都是 center spread. 若需要 Down spread則可以由 center spread搭配 改變後的 frequency(類似直流準位)來達成

* x( ^5 z* T8 r( V給我正確的頻率,其餘免談 ...^_^...
% ]0 n( o/ Y9 U+ E2 h/ ~, S& I! E
* T6 a- P! t7 r2 C=====================================================================
; N. H" H3 @# x) \; ~Q&A
5 z3 E. O1 A5 I# k1 k, x" t=====================================================================
8 \, E) C- X* L: P5 l>前輩我有幾個問題要發問!
>1. 你這邊說的Table方式頻率是指供應給CPU頻率嗎? Intel網站的CPU說明，他說是固定的不可調的? 所以這不是HW固定住(Latch)設定值了嗎?
>
+ s! l& H) M! S% [>2. 可以解釋一下Down Spread/Center Spread /...所代表的意思嗎? 還有用途?
$ l6 {% g9 p0 G. j4 i+ X2 j>
2 C3 `1 f$ G5 H9 |% D>3. 我目前也在嘗試Program ClcokGen(新手上路)，很多專有名詞還沒搞懂，另外目前ClockGen不是可以
>輸出不同頻率嗎? 為什麼Table方式只需要Program 1 byte就好 ???還是說各家廠商設定方式不同，有些廠
>商只要利用1 Byte 就已經選擇好所有的頻率了(33MHZ/48MHz/DOT96MHZ/LCD27MHZ...)?

1 [% b1 a$ g4 S( E9 u0 d[For #1]
=> 我所謂的 "Table"方式指的是: 為了方便設定,clockgen designer會專門提供一個byte register(8-bit);此 byte的某些 bit fields(Ex. bit[4:0])可以讓programmer填一組值,例如 01001b. 此值 write 至 clockgen成功後, CPU/DRAM/AGP/PCI/...etc 都會是固定的頻率. Ex. 100/133/66/33/...etc. 所以才說只填 1 byte only !
' C0 {9 u; l& r" p
2 I) ^- ^, w# G6 m) w8 D7 q此值一旦填至 clockgen, clockgen便依據該 byte(可參考 spec前幾頁,會有一張表說明: bit[4:0] <-> frequency combinations)來產生出 frequencies.
4 q# p5 z& i- R1 w9 m  H
不管用哪一種方式(table or linear mode),都會 supply CPU frequency !!!不過,此時的 CPU frequency is CPU的外頻 ( CPU 總頻率(core) = (外頻)*(倍頻 <-multiplier) )

Ex. 外頻 200MHz(Merom CPU, FSB 800),倍頻 = 12 -> core freq = 2.4GHz
  V1 n% O2 L9 s' a9 c3 l
還有,BIOS可以調整 外頻 & 倍頻 ! 沒問題 ! 不過,若遇到鎖頻的CPU(Ex. 量產版的CPU),倍頻可能無法調整.但外頻還是可以靠 config clockgen來達到 !!!

For #2
=> 假設要達到 100MHz 且 SS = 0.5% center spread.則:
(...想像以前學的直流與交流的訊號...)

100MHz 相當於 直流的部分,其值不隨時間而變; 0.5% center spread好比弦波訊號(振幅是 100M * 0.005 * (1/2);所以,兩者的合成便是: 以 100MHz為中心,其值隨時間而變,振幅 is 100M * 0.005 * (1/2) 的訊號 !!!
8 i! r8 Z5 x& V4 D- T0 A
3 |# M/ Z" @# t4 L我 '猜' 要這樣測試的原因是:所產生的 clock一定不會是 perfect的 100MHz,有可能因為元件或是外部干擾而被 "改變".為了模擬這樣的情況,我們會將 clock的 spread spectrum enable,產生 "隨時間而改變"的頻率,來測試系統的穩定度...等
4 I3 E& k1 Y/ r9 r  K( E% t7 T9 I
: Q& ~# x4 B/ _- ?: U* nDown spread 0.5% 指的是:距離 水平 100MHz, 最低的值是 100M-100M*0.005,最高值則是 100M本身( 等同於: 水平值 99.5 + center spread 0.5%, right ? )

For #3
% t; e/ C; `) h0 `, ?& t=> 前面提過,只設 1 byte 就可以產生所有頻率是因為: clockgen公司已經把設定各頻率的功能"濃縮"在一個 byte裡面 ; programmer只要 config this byte 就可以了...

5 M9 j) O) \. S* 關於 EMI 測試部分,有錯請指正. ( ...我有用到 "猜" 字眼...^_^ )

( H1 {: s. G6 _& [6 w! s- h[[EMI 測試的知識]]
2 Y( n1 Q' K0 e0 c由於 對clock信號來說. 鋒(peak)值是能量最強的地方. 所以peak的能量就會不斷累積, 發射出來. 因此在頻譜上就會出現能量很強的頻率. EMI 工程師的工作就是要想辦法屏閉這些電磁波的干擾.　

4 j2 V" @2 g2 Y/ Y" y為什麼需要 spread spectrum? 由於PLL 十分精準. 也就是說 100MHz的clock, 其 peak & peak之間的距離一致(波長固定). 所以能量十分驚人. 使用展頻可以使 peak 的距離改變(由於頻率不斷的在一個範圍內改變, 這個可以用示波器累積clock信號來看) 所以累積的能量會比較低. 這樣EMI 可以比較好處理.
+ h+ ]  e$ I, \4 @: Y$ i6 `
至於為什麼會有要求BIOS一開始就把展頻開著, 以確保板子的穩定? 很簡單.不開展頻clock很穩定.自然比較不會有問題. 展頻一開. 由於頻率是浮動的. 很多設計欠佳的板子就會不穩定. 及早發現才能及早修改.